薪資詳情
發(fā)放方式：每月15日?????
崗位職責
1.承擔芯片項目 SOC 系統(tǒng)級設(shè)計、集成設(shè)計、頂層和 IO 設(shè)計，拉通芯片各 CBB 及端到端實現(xiàn)流程。
2.開發(fā) FPGA 原型平臺系統(tǒng)，支持芯片項目的 SoC 設(shè)計驗證及 CBB 設(shè)計驗證。
3.負責數(shù)字模塊開發(fā)與交付，包括需求規(guī)格分解、方案設(shè)計、代碼實現(xiàn)、仿真驗證、 SYN / STA 等端到端設(shè)計流程。
崗位要求
1.熟悉 Verilog 語言、 SOC 體系架構(gòu)、典型電路設(shè)計、具備數(shù)字邏輯開發(fā)經(jīng)驗。
2.或者熟練掌握 FPGA 邏輯設(shè)計方法，熟悉 FPGA 硬件特點，掌握 FPGA 版本設(shè)計， FPGA 問題定位方法。
3.質(zhì)量意識好，善于溝通交流與合作。
4.2026屆畢業(yè)生。
工作地址
山東省青島市黃島區(qū)·海信靈山國際
HR信息
林經(jīng)理
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